FPGA 时序约束 一 ：如何查看时序错误_ise查看时钟裕量

1、时序错误的影响

      一个设计的时序报告中，design run 时序有红色，裕量（slack）为负数时，表示时序约束出现违例，虽然个别违例不代表你的工程就有致命的问题，但是这是一个风险（时序报告是按照工艺、电压以及温度的上下限给出的结果）。当违例数较多，也就意味着设计在实际环境中出现问题的概率也会越大。

      时间裕量包括建立时间裕量和保持时间裕量（setup slack和hold slack）。从字面上理解，所谓“裕量”即富余的、多出的。什么意思呢？即保持最低要求的建立时间或保持时间所多出的时间，那么“裕量”越多，意味着时序约束越宽松。

2、如何查看具体错误的时序路径

      上述错误的时序，双击可以看到详细的时钟路径和数据路径，右键可以看到具体代码中的原理图。个人比较喜欢先查看原理图可以很直观的看到到底是哪一块的代码错了。

     在调试的过程中发现，基本上时序错误都是代码的错误，比如没有跨时钟操作࿰