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希望可以通过这次毕业设计学到更多有用的东西
已经完成的工作有设计目标1和5(2021.1.8)
接下来的任务:
极化码译码的verilog语言,需要选择输入llr值的定点数位数,还需仿真选择最优方案
python上位机功能已经实现,UI界面尚未编写
lwip协议栈工作原理仍需进一步掌握
这东西早就做完了,但我不想更了